硬件原理图Checklist+PCB checklist|Allegro|OrCAD - 逆天PCB论坛

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提示：会员销售的附件,下载积分 = 版块积分 + 销售积分只看楼主倒序阅读使用道具 0楼发表于: 2017-12-02

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硬件原理图Checklist检查表

PCB的Checklist

一、资料输入阶段
1.在流程上接收到的资料是否齐全（包括：原理图、*.brd文件、料单、PCB设计说明以及PCB设计或更改要求、标准化要求说明、工艺设计说明文件）
2.确认PCB模板是最新的
3. 确认模板的定位器件位置无误
4.PCB设计说明以及PCB设计或更改要求、标准化要求说明是否明确
5.确认外形图上的禁止布放器件和布线区已在PCB模板上体现
6.比较外形图，确认PCB所标注尺寸及公差无误, 金属化孔和非金属化孔定义准确
7.确认PCB模板准确无误后最好锁定该结构文件，以免误操作被移动位置
二、布局后检查阶段
a.器件检查
8, 确认所有器件封装是否与公司统一库一致，是否已更新封装库（用viewlog检查运行结果）如果不一致，一定要Update Symbols
9, 母板与子板，单板与背板，确认信号对应，位置对应，连接器方向及丝印标识正确，且子板有防误插措施，子板与母板上的器件不应产生干涉
10, 元器件是否100% 放置
11, 打开器件TOP和BOTTOM层的place-bound，查看重叠引起的DRC是否允许
12, Mark点是否足够且必要
13, 较重的元器件，应该布放在靠近PCB支撑点或支撑边的地方，以减少PCB的翘曲
14, 与结构相关的器件布好局后最好锁住，防止误操作移动位置
15, 压接插座周围5mm范围内，正面不允许有高度超过压接插座高度的元件，背面不允许有元件或焊点
16, 确认器件布局是否满足工艺性要求（重点关注BGA、PLCC、贴片插座）
17, 金属壳体的元器件，特别注意不要与其它元器件相碰，要留有足够的空间位置
18, 接口相关的器件尽量靠近接口放置，背板总线驱动器尽量靠近背板连接器放置
19, 波峰焊面的CHIP器件是否已经转换成波峰焊封装，
20, 手工焊点是否超过50个
21, 在PCB上轴向插装较高的元件，应该考虑卧式安装。留出卧放空间。并且考虑固定方式，如晶振的固定焊盘
22, 需要使用散热片的器件，确认与其它器件有足够间距，并且注意散热片范围内主要器件的高度
b.功能检查
23, 数模混合板的数字电路和模拟电路器件布局时是否已经分开，信号流是否合理
24, A/D转换器跨模数分区放置。
25, 时钟器件布局是否合理
26, 高速信号器件布局是否合理
27, 端接器件是否已合理放置（源端匹配串阻应放在信号的驱动端；中间匹配的串阻放在中间位置；终端匹配串阻应放在信号的接收端）
28, IC器件的去耦电容数量及位置是否合理
29, 信号线以不同电平的平面作为参考平面，当跨越平面分割区域时，参考平面间的连接电容是否靠近信号的走线区域。
30, 保护电路的布局是否合理，是否利于分割
31, 单板电源的保险丝是否放置在连接器附近，且前面没有任何电路元件
32, 确认强信号与弱信号（功率相差30dB）电路分开布设
33, 是否按照设计指南或参考成功经验放置可能影响EMC实验的器件。如：面板的复位电路要稍靠近复位按钮
c.发热
34, 对热敏感的元件（含液态介质电容、晶振）尽量远离大功率的元器件、散热器等热源
35, 布局是否满足热设计要求，散热通道（根据工艺设计文件来执行）
d.电源
36, 是否IC电源距离IC过远
37, LDO及周围电路布局是否合理
38, 模块电源等周围电路布局是否合理
39, 电源的整体布局是否合理
e.规则设置
40, 是否所有仿真约束都已经正确加到Constraint Manager中
41, 是否正确设置物理和电气规则（注意电源网络和地网络的约束设置）
42, Test Via、Test Pin的间距设置是否足够
43, 叠层的厚度和方案是否满足设计和加工要求
44, 所有有特性阻抗要求的差分线阻抗是否已经经过计算，并用规则控制
三、布线后检查阶段
e.数模
45, 数字电路和模拟电路的走线是否已分开，信号流是否合理
46, A/D、D/A以及类似的电路如果分割了地，那么电路之间的信号线是否从两地之间的桥接点上走（差分线例外）？
47, 必须跨越分割电源之间间隙的信号线应参考完整的地平面。
48, 如果采用地层设计分区不分割方式，要确保数字信号和模拟信号分区布线。
f.时钟和高速部分
49, 高速信号线的阻抗各层是否保持一致
50, 高速差分信号线和类似信号线，是否等长、对称、就近平行地走线？
51, 确认时钟线尽量走在内层
52, 确认时钟线、高速线、复位线及其它强辐射或敏感线路是否已尽量按3W原则布线
53, 时钟、中断、复位信号、百兆/千兆以太网、高速信号上是否没有分叉的测试点？
54, LVDS等低电平信号与TTL/CMOS信号之间是否尽量满足了10H（H为信号线距参考平面的高度）？
55, 时钟线以及高速信号线是否避免穿越密集通孔过孔区域或器件引脚间走线？
56, 时钟线是否已满足（SI约束）要求（时钟信号走线是否做到少打过孔、走线短、参考平面连续，主要参考平面尽量是GND；若换层时变换了GND主参考平面层，在离过孔200mil范围之内是GND过孔）若换层时变换不同电平的主参考平面，在离过孔200mil范围之内是否有去耦电容）？
57, 差分对、高速信号线、各类BUS是否已满足（SI约束）要求
g.EMC与可靠性
58, 对于晶振，是否在其下布一层地？是否避免了信号线从器件管脚间穿越？对高速敏感器件，是否避免了信号线从器件管脚间穿越？
59, 单板信号走线上不能有锐角和直角（一般成 135 度角连续转弯，射频信号线最好采用圆弧形或经过计算以后的切角铜箔）
60, 对于双面板，检查高速信号线是否与其回流地线紧挨在一起布线；对于多层板，检查高速信号线是否尽量紧靠地平面走线
61, 对于相邻的两层信号走线，尽量垂直走线
62, 避免信号线从电源模块、共模电感、变压器、滤波器下穿越
63, 尽量避免高速信号在同一层上的长距离平行走线
64, 板边缘还有数字地、模拟地、保护地的分割边缘是否有加屏蔽过孔？多个地平面是否用过孔相连?过孔距离是否小于最高频率信号波长的1/20？
65, 浪涌抑制器件对应的信号走线是否在表层短且粗？
66, 确认电源、地层无孤岛、无过大开槽、无由于通孔隔离盘过大或密集过孔所造成的较长的地平面裂缝、无细长条和通道狭窄现象
67, 是否在信号线跨层比较多的地方，放置了地过孔（至少需要两个地平面）
h.电源和地
68, 如果电源/地平面有分割，尽量避免分割开的参考平面上有高速信号的跨越。
69, 确认电源、地能承载足够的电流。过孔数量是否满足承载要求,（估算方法：外层铜厚1oz时1A/mm线宽，内层0.5A/mm线宽，短线电流加倍）
70, 对于有特殊要求的电源，是否满足了压降的要求
71, 为降低平面的边缘辐射效应，在电源层与地层间要尽量满足20H原则。（条件允许的话，电源层的缩进得越多越好）。
72, 如果存在地分割，分割的地是否不构成环路？
73, 相邻层不同的电源平面是否避免了交叠放置？
74, 保护地、-48V地及GND的隔离是否大于2mm？
75, -48V地是否只是-48V的信号回流，没有汇接到其他地？如果做不到请在备注栏说明原因。
76, 靠近带连接器面板处是否布10~20mm的保护地，并用双排交错孔将各层相连？
77, 电源线与其他信号线间距是否距离满足安规要求？
i.禁布区
78, 金属壳体器件和散热器件下，不应有可能引起短路的走线、铜皮和过孔
79, 安装螺钉或垫圈的周围不应有可能引起短路的走线、铜皮和过孔
80, 设计要求中预留位置是否有走线
81, 非金属化孔内层离线路及铜箔间距应大于0.5mm（20mil），外层0.3mm（12mil）,单板起拔扳手轴孔内层离线路及铜箔间距应大于2mm（80mil）
82, 铜皮和线到板边推荐为大于2mm 最小为0.5mm
83, 内层地层铜皮到板边 1 ~ 2 mm，最小为0.5mm
j.焊盘出线
84, 对于两个焊盘安装的CHIP元件（0805及其以下封装），如电阻、电容，与其焊盘连接的印制线最好从焊盘中心位置对称引出，且与焊盘连接的印制线必须具有一样的宽度，对于线宽小于0.3mm(12mil)的引出线可以不考虑此条规定
85, 与较宽印制线连接的焊盘，中间最好通过一段窄的印制线过渡？（0805及其以下封装）
86, 线路应尽量从SOIC、PLCC、QFP、SOT等器件的焊盘的两端引出
k.丝印
87, 器件位号是否遗漏，位置是否能正确标识器件
88, 器件位号是否符合公司标准要求
89, 确认器件的管脚排列顺序，第1脚标志，器件的极性标志，连接器的方向标识的正确性
90, 母板与子板的插板方向标识是否对应
91, 背板是否正确标识了槽位名、槽位号、端口名称、护套方向
92, 确认设计要求的丝印添加是否正确
93, 确认已经放置有防静电和射频板标识（射频板使用）
l.编码/条码
94, 确认PCB编码正确且符合公司规范
95, 确认单板的PCB编码位置和层面正确（应该在A面左上方,丝印层）
96, 确认背板的PCB编码位置和层面正确（应该在B右上方,外层铜箔面）
97, 确认有条码激光打印白色丝印标示区
98, 确认条码框下面没有连线和大于0.5mm导通孔
99, 确认条码白色丝印区外20mm范围内不能有高度超过25mm的元器件
m.过孔
100, 在回流焊面，过孔不能设计在焊盘上。（正常开窗的过孔与焊盘的间距应大于0.5mm （20mil），绿油覆盖的过孔与焊盘的间距应大于0.1 mm （4mil），方法：将Same Net DRC打开，查DRC，然后关闭Same Net DRC）
101, 过孔的排列不宜太密，避免引起电源、地平面大范围断裂
102, 钻孔的过孔孔径最好不小于板厚的1/10
n.工艺
103, 器件布放率是否100%，布通率是否100%（没有达到100%的需要在备注中说明）
104, Dangling线是否已经调整到最少，对于保留的Dangling线已做到一一确认；
105, 工艺科反馈的工艺问题是否已仔细查对
o.大面积铜箔
106, 对于Top、bottom上的大面积铜箔，如无特殊的需要，应用网格铜[单板用斜网，背板用正交网，线宽0.3mm （12 mil）、间距0.5mm （20mil）]
107, 大面积铜箔区的元件焊盘，应设计成花焊盘，以免虚焊；有电流要求时，则先考虑加宽花焊盘的筋，再考虑全连接
108, 大面积布铜时，应该尽量避免出现没有网络连接的死铜（孤岛）
109, 大面积铜箔还需注意是否有非法连线，未报告的DRC
p.测试点
110, 各种电源、地的测试点是否足够（每2A电流至少有一个测试点）
111, 确认没有加测试点的网络都是经确认可以进行精简的
112, 确认没有在生产时不安装的插件上设置测试点
113, Test Via、Test Pin是否已Fix（适用于测试针床不变的改板）
q.DRC
114, Test via 和Test pin 的Spacing Rule应先设置成推荐的距离，检查DRC，若仍有DRC存在，再用最小距离设置检查DRC
115, 打开约束设置为打开状态，更新DRC，查看DRC中是否有不允许的错误
116, 确认DRC已经调整到最少，对于不能消除DRC要一一确认；
r.光学定位点
117, 确认有贴装元件的PCB面已有光学定位符号
118, 确认光学定位符号未压线（丝印和铜箔走线）
119, 光学定位点背景需相同，确认整板使用光学点其中心离边≥5mm
120, 确认整板的光学定位基准符号已赋予坐标值（建议将光学定位基准符号以器件的形式放置），且是以毫米为单位的整数值。
121, 管脚中心距<0.5mm的IC，以及中心距小于0.8 mm（31 mil）的BGA器件，应在元件对角线附近位置设置光学定位点
s.阻焊检查
122, 确认是否有特殊需求类型的焊盘都正确开窗（尤其注意硬件的设计要求）
123, BGA下的过孔是否处理成盖油塞孔
124, 除测试过孔外的过孔是否已做开小窗或盖油塞孔
125, 光学定位点的开窗是否避免了露铜和露线
126, 电源芯片、晶振等需铜皮散热或接地屏蔽的器件，是否有铜皮并正确开窗。由焊锡固定的器件应有绿油阻断焊锡的大面积扩散
四、出加工文件
t.钻孔图
127, Notes的PCB板厚、层数、丝印的颜色、翘曲度，以及其他技术说明是否正确
128, 叠板图的层名、叠板顺序、介质厚度、铜箔厚度是否正确；是否要求作阻抗控制，描述是否准确。叠板图的层名与其光绘文件名是否一致
129, 将设置表中的Repeat code 关掉，钻孔精度应设置为2－5
130, 孔表和钻孔文件是否最新（改动孔时，必须重新生成）
131, 孔表中是否有异常的孔径，压接件的孔径是否正确；孔径公差是否标注正确
132, 要塞孔的过孔是否单独列出，并标注“filled vias”
u.光绘
133, 光绘文件输出尽量采用RS274X格式，且精度应设置为5：5
134, art_aper.txt 是否已最新（274X可以不需要）
135, 输出光绘文件的log文件中是否有异常报告
136, 负片层的边缘及孤岛确认
137, 使用光绘检查工具检查光绘文件是否与PCB 相符(改板要使用比对工具进行比对)
五、文件齐套
138, PCB文件：产品型号_规格_单板代号_版本号.brd
139, 背板的衬板设计文件：产品型号_规格_单板代号_版本号-CB[-T/B].brd
140, PCB加工文件：PCB编码.zip（含各层的光绘文件、光圈表、钻孔文件及ncdrill.log；拼板还需要有工艺提供的拼板文件*.dxf）,背板还要附加衬板文件：PCB编码-CB[-T/B].zip （含drill.art、*.drl、ncdrill.log）
141, 工艺设计文件：产品型号_规格_单板代号_版本号-GY.doc
142, SMT坐标文件：产品型号_规格_单板代号_版本号-SMT.txt,（输出坐标文件时，确认选择 Body center，只有在确认所有SMD器件库的原点是器件中心时，才可选Symbol origin）
143, PCB板结构文件：产品型号_规格_单板代号_版本号-MCAD.zip(包含结构工程师提供的.DXF与.EMN文件)
144, 测试文件：产品型号_规格_单板代号_版本号-TEST.ZIP(包含testprep.log 和 untest.lst或者*.drl测试点的坐标文件)
145, 归档图纸文件：产品型号规格-单板名称-版本号.pdf,（包括：封面、首页、各层丝印、各层线路、钻孔图、背板含有衬板图）
六、标准化
146, 确认封面、首页信息正确
147, 确认图纸序号（对应PCB各层顺序分配）正确的
148, 确认图纸框上PCB编码是正确的

其他补充

USB
1    足够的bypass 电容(usually 100uF)应该靠近USB header来防止voltage droop. 电流按1A/Port计算
2    要有防静电的线路设计
3    每对差分信号线上要串common chock或0ohm
4    Over current信号要连到给USB供电的5V电源上,并且要分压
5    需要考虑USB设备电流倒灌到主板，确认是否需要添加switch
SATA
1    sata供电5V 需要放足够大（一般要求大于270UF）电容，防止电压drop
2    按照标准的SATA接口设计，5V和12V都需要接好。有些2.5寸硬盘需要12V供电，在设计时应尽量按照标准设计
3    SATA AC耦合电容容值0.01uf
VGA
1    22 or 33 ohm damping resister is in series with VSYNC/HSYNC
2    VGA OUTPUT R.G. B HSYNC,VSYNC需要有保护二极体; HSYNC，VSYNC电平转换建议用IC来实现
3    If CRT I2C bus signal level-shift circuit is used, check if the voltage level and quality with different monitors at both sides.
4    R,G,B信号线在发送端和接收端都要有150ohm对GND电阻，或者只在接受端加75ohm对地电阻，另外信号RGB信号需要添加pi型滤波电路。
Lan
1    确认PHY芯片与RJ45之间是否需要终端匹配电阻
2    选择RJ45时要注意内部的组成结构(1-2,3-6,4-5,7-8)
3    RJ45（包含Tansformer）的抽头电压要依据网卡的参考设计
4    MAC和PHY之前是否需要终端匹配电路。
5    如果是交换机线路，需注意在每一个管理bus(MDC/MDIO)上的PHY的地址不能一样。
6    注意千兆网络和百兆网络设计的区别，有些RJ45只支持10/1000M
7    在两个网口对接时注意网线3和6这两跟线的线序
8    关于RJ45接头中的LED，建议Symbol中能体现出二极管的极性，注意State和ACT两个信号的接法
9    注意不同颜色LED指示内容(Active/Link/Speed)是否和产品需求、机构丝印一致
10    在使用多Port RJ45/SFP/SFP+时，注意LED和端口的对应关系。Layout过程中调线时，尤其注意不仅要调整总线，对应的LED也要调整
复位
1    一个RESET pin最多只可以同时接4个Device
2    如果将reset信号定为open drain时，则要外部上拉。
3    为确保Reset信号上升时间足够好，只可加pf级以下的电容
4    Reset线路需注意电平是否跟芯片要求的一致，如3.3V还是2.5V。
5    确认reset是在上电稳定之后有效
PCI
PCI IDSEL选择一定要选择AD22（含）之前的（仅针对AST2050芯片），普通Device要是AD16-31。
PCI-E
PCI-E X16 Lane反转注意；差分对之间的P/N可以翻转。请check控制芯片的datasheet,X16,X8,X4翻转各个平台不一样的。
ESD防护
1    USB,VGA及COM口需增加ESD防护器件。USB的防护器件推荐使用PTS0603V24T500;VGA的防护器件推荐使用BAT54S;COM口防护器件推荐使用PTS0402V14T500。
2    将信号GND(singal gnd）和机壳地（shield gnd）进行隔离。隔离器件可使用0欧姆电阻，磁珠（bead），小电容。