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[问题求助]Altium designer规则设置 [复制链接]

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离线花岗小岩
 

在进行布局的过程中发现有报错的情况,我对规则的设定不是很熟悉,希望能够找到报错的原因: MymsDdQ]  
1、FPGA芯片的封装由几部分组成,在绘制版图的时候是否应当把各个部分的封装叠加到一起? Ewp2 1  
2、在FPGA的封装报错: 3'kKbrk [  
2<5LQr  
8)eRm{  
请问是哪里出错了? S$hxR  
3、单个器件的封装出现问题(cap) ^8~TsK~  
hWbu Z%  
:t!J 9  
B=K<k+{6"  
请问应当如何解决这些报错的问题? ;"Qq/ knVL  


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离线mirage

只看该作者 1楼 发表于: 2019-09-24
谢谢分享


离线luchonghui74

只看该作者 2楼 发表于: 2019-09-24
学习!学习!



只看该作者 3楼 发表于: 2019-09-24
谢谢楼主分享 SP2";,%/9  



只看该作者 4楼 发表于: 2019-09-24
谢谢楼主分享 'zt}\ Dt  


离线hbjsss

只看该作者 5楼 发表于: 2019-09-24


离线kanxue_nmg

只看该作者 6楼 发表于: 2019-09-25
    


离线sun5304

只看该作者 7楼 发表于: 2019-09-25
  


离线郑先生

只看该作者 8楼 发表于: 2019-09-25
    


离线io357

只看该作者 9楼 发表于: 2019-09-25
1.一个元件应该是一个封装 rds 4eUxe  
2.看错误是Top层表贴焊盘与铺铜短路; 还有一个错误是元件间距小于10mil;  =v!'?  
3.电容的的1脚和2脚封装库就是短路的?
[ 此帖被io357在2019-09-25 08:35重新编辑 ]


离线bbkhslhj

只看该作者 10楼 发表于: 2019-09-25


离线acolick

只看该作者 11楼 发表于: 2019-09-25


离线alex-zhang

只看该作者 12楼 发表于: 2019-09-25
    


离线ilpuyi

只看该作者 13楼 发表于: 2019-09-25
    



只看该作者 14楼 发表于: 2019-09-25
继续加油


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