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[最新新闻]从fail到pass,DDR调试到底经历了什么 [复制链接]

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离线jupitars
 

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提示:会员销售的附件,下载积分 = 版块积分 + 销售积分       只看楼主 倒序阅读 使用道具 0楼 发表于: 07-27
做DDR的调试无非以下三种结果:调试fail、调试pass和调试很久才pass。你可能永远也想象不到PCB工程师花几天设计出来的DDR模块在加工出来后调试就多久才pass,一天?一周?一个月?甚至…… %j,Ny}a   
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高速先生近几年来在DDR设计仿真取得了长足的进步,这要得益于AI(人工智能)的热潮,作为该领域的核心产品,AI算力卡成为近年来各大通讯公司和芯片公司争相研发的产品。而其中DDR模块则是AI算力卡里最核心的模块,支撑着算力卡大容量、快速的运算能力。 uH#NJoR O  
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高速先生在和各大公司合作的情况下,也有机会接触到了形形色色的AI算力卡,它里面的DDR模块虽然实现的功能类似,但是具体的结构却有着很多的变化。例如容量的不一样导致颗粒数量的不同;板子的大小不一样导致采用的拓扑不同;PCB层数的不一样导致DDR模块的布局和密度也不相同;有的由于功耗电流大小不一样导致DDR走线参考层也不相同,有的需要参考电源层,有的需要相邻层走线;当然还有的就是需要跑到的目标速率不同,我们在设计上的设计裕量也会有所差异等等。因此对于我们高速先生来说,每一块算力卡的DDR设计都是不同的,当然设计加工出来之后,我们和客户配合着去调试的难度也是不一样的。这一块高速先生在近几年的研讨会上也和大家分享过一些经典的案例,让大家对DDR的设计和调试难度都有了新的认识,AI产品的一些特点关于它的设计使得比以往任何产品的DDR难度都要大一点,当然我们也就会有很多测试和仿真的案例了。这里关于DDR调试的案例,我们再给大家分享一个从fail到pass的经历哈。 WBGYk);  
在一个安静祥和的午后,高速先生刚刚还略带点午睡的困意开始下午的工作,就突然收到了客户一份很“提神”的邮件,让大家立马精神了起来。 {BF\G%v;+  
原来是客户在我们公司设计加工的一款主力的AI算力卡出现了调试fail的问题,客户本身是一家很有研发能力而且很严谨的公司,它们对硬件原理和调试都是具有丰富的经验,然而这款产品的DDR模块他们调试了几周都依然没办法成功。由于是我司PCB工程师设计的板子,因此高速先生肯定是临危受命,去负责介入到他们的调试中去。 \ gN) GR  
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高速先生打开PCB文件,看到了FPGA和C1这个DDR通道的连接,这个通道是由9个DDR颗粒组成,也就是我们所说的1拖9的DDR拓扑。由于板子的密度很大,因此只能采取正反贴的形式进行布局布线,如下图所示。 *QVE>{  
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由于FPGA芯片是有关于DDR的设计指导文档,我司的PCB工程师和客户在投板前也反复确认了该DDR模块的设计是完全按照文档上面每一条细致的指导去布线的。例如下图的L0,L1,L2等每段长度文档上都是有要求。 *=8)]_=f  
客户就是因为觉得都按照了上面的设计指导进行布局布线,认为设计其实是达到了要求,因此才坚持着花费了近一个月的时间进行调试,希望能从调试中去解决问题。高速先生介入后,发现客户的调试其实已经做了很多内容,包括驱动内阻的变化,ODT电阻的变化,电源电压的微调,VTT电阻的改变,飞线等等,但是仍然无法达到额定的2400Mbps的速率。由于这