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[技术讨论]FPGA的PS端DRR4 72bit 带ECC怎么设计 [复制链接]

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离线shufei

性别:: 人妖

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提示：会员销售的附件,下载积分 = 版块积分 + 销售积分只看楼主倒序阅读使用道具 0楼发表于: 2021-01-26

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请教下，用16位DDR4设计成72bit带ECC的，第五片DDR高八位数据线和DQS和DM怎处理是悬空还是上下拉，有没有设计规范和标准，在调试时把32-64对应两片不焊接是否能组成32位带ECC，第五片不焊接时是否能组成64bit 不带ECC？

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在线ai317

性别:: 帅哥

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买个成品自己量下？

离线李生919

性别:: 人妖

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离线sunny998

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感谢分享

小蜜蜂

离线leslie_aqiang

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离线郑先生

性别:: 帅哥

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离线lik818

性别:: 人妖

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离线nj20044

性别:: 帅哥

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离线流萤

性别:: 人妖

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离线asdf140

性别:: 美女

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提示：会员销售的附件,下载积分 = 版块积分 + 销售积分只看该作者 9楼发表于: 2021-02-07

去VIVADO上打开芯片看一下支持不支持，一般PS那边不支持72位的，只支持64位最高，PL那边应该支持，