上拉电阻、下拉电阻的原理和作用-模拟/数字
一.应用1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。2、OC门电路必须加上拉电阻，以提高输出的搞电平值。3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。3、对于高速电路，过大的上拉电阻可能边沿变平缓。综合考虑以上三点,通常在1k到10k之间选取。对下拉电阻也有类似道理。二.原理：上拉电阻实际上是集电极输出的负载电阻。不管是在开关应用和模拟放大，此电阻的选则都不是拍脑袋的。工作在线性范围就不多说了，在这里是讨论的是晶体管是开关应用，所以只谈开关方式。找个TTL器件的资料单独看末级就可以了，内部都有负载电阻根据不同驱动能力和速度要求这个电阻值不同，低功耗的电阻值大，速度快的电阻值小。但芯片制造商很难满足应用的需要不可能同种功能芯片做许多种，因此干脆不做这个负载电阻，改由使用者自己自由选择外接，所以就出现OC、OD输出的芯片。由于数字应用时晶体管工作在饱和和截止区，对负载电阻要求不高，电阻值小到只要不小到损坏末级晶体管就可以，大到输出上升时间满足设计要求就可，随便选一个都可以正常工作。但是一个电路设计是否优秀这些细节也是要考虑的。集电极输出的开关电路不管是开还是关对地始终是通的，晶体管导通时电流从负载电阻经导通的晶体管到地，截止时电流从负载电阻经负载的输入电阻到地，如果负载电阻选择小点功耗就会大，这在电池供电和要求功耗小的系统设计中是要尽量避免的，如果电阻选择大又会带来信号上升沿的延时，因为负载的输入电容在上升沿是通过无源的上拉电阻充电，电阻越大上升时间越长，下降沿是通过有源晶体管放电，时间取决于器件本身。因此设计者在选择上拉电阻值时，要根据系统实际情况在功耗和速度上兼顾。三.从IC(MOS工艺)的角度,分别就输入/输出引脚做一解释:1. 对芯片输入管脚, 若在系统板上悬空(未与任何输出脚或驱动相接)是比较危险的.因为此时很有可能输入管脚内部电容电荷累积使之达到中间电平(比如1.5V), 而使得输入缓冲器的PMOS管和NMOS管同时导通, 这样一来就在电源和地之间形成直接通路, 产生较大的漏电流, 时间一长就可能损坏芯片. 并且因为处于中间电平会导致内部电路对其逻辑(0或1)判断混乱. 接上上拉或下拉电阻后, 内部点容相应被充(放)电至高(低)电平, 内部缓冲器也只有NMOS(PMOS)管导通, 不会形成电源到地的直流通路. (至于防止静电造成损坏, 因芯片管脚设计中一般会加保护电路, 反而无此必要).2. 对于输出管脚: ^1)正常的输出管脚(push-pull型), 一般没有必要接上拉或下拉电阻.2)OD或OC(漏极开路或集电极开路)型管脚,这种类型的管脚需要外接上拉电阻实现线与功能(此时多个输出可直接相连. 典型应用是: 系统板上多个芯片的INT(中断信号)输出直接相连, 再接上一上拉电阻, 然后输入MCU的INT引脚, 实现中断报警功能).其工作原理是:在正常工作情况下, OD型管脚内部的NMOS管关闭, 对外部而言其处于高阻状态, 外接上拉电阻使输出位于高电平(无效中断状态); 当有中断需求时, OD型管脚内部的NMOS管接通, 因其导通电阻远远小于上拉电阻, 使输出位于低电平(有效中断状态). 针对MOS 电路上下拉电阻阻值以几十至几百K为宜.上拉电阻：1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。2、OC门电路必须加上拉电阻，才能使用。3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。3、对于高速电路，过大的上拉电阻可能边沿变平缓。综合考虑以上三点,通常在1k到10k之间选取。对下拉电阻也有类似道理对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定，主要需要考虑以下几个因素：1． 驱动能力与功耗的平衡。以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应注意两者之间的均衡。2． 下级电路的驱动需求。同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路提供足够的电流。3． 高低电平的设定。不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出正确的电平。以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。4． 频率特性。以上拉电阻为例，上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟，电阻越大，延迟越大。上拉电阻的设定应考虑电路在这方面的需求。下拉电阻的设定的原则和上拉电阻是一样的。OC门输出高电平时是一个高阻态，其上拉电流要由上拉电阻来提供，设输入端每端口不大于100uA,设输出口驱动电流约500uA，标准工作电压是5V，输入口的高低电平门限为0.8V(低于此值为低电平)；2V(高电平门限值)。选上拉电阻时500uA x 8.4K= 4.2即选大于8.4K时输出端能下拉至0.8V以下，此为最小阻值，再小就拉不下来了。如果输出口驱动电流较大，则阻值可减小，保证下拉时能低于0.8V即可。当输出高电平时，忽略管子的漏电流，两输入口需200uA200uA x15K=3V即上拉电阻压降为3V，输出口可达到2V，此阻值为最大阻值，再大就拉不到2V了。选10K可用。COMS门的可参考74HC系列 设计时管子的漏电流不可忽略，IO口实际电流在不同电平下也是不同的，上述仅仅是原理，一句话概括为：输出高电平时要喂饱后面的输入口，输出低电平不要把输出口喂撑了（否则多余的电流喂给了级联的输入口，高于低电平门限值就不可靠了） 在数字电路中不用的输入脚都要接固定电平，通过1k电阻接高电平或接地。1. 电阻作用： 接电组就是为了防止输入端悬空 减弱外部电流对芯片产生的干扰 保护cmos内的保护二极管,一般电流不大于10mA 1. 改变电平的电位，常用在TTL-CMOS匹配2. 在引脚悬空时有确定的状态3.增加高电平输出时的驱动能力。4、为OC门提供电流 .l 那要看输出口驱动的是什么器件，如果该器件需要高电压的话，而输出口的输出电压又不够，就需要加上拉电阻。l 如果有上拉电阻那它的端口在默认值为高电平你要控制它必须用低电平才能控制如三态门电路三极管的集电极，或二极管正极去控制把上拉电阻的电流拉下来成为低电平。反之，l 尤其用在接口电路中,为了得到确定的电平,一般采用这种方法,以保证正确的电路状态,以免发生意外,比如,在电机控制中,逆变桥上下桥臂不能直通,如果它们都用同一个单片机来驱动,必须设置初始状态.防止直通2、定义： _l 上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！l 上拉是对器件注入电流，下拉是输出电流l 弱强只是上拉电阻的阻值不同，没有什么严格区分l 对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。3、为什么要使用拉电阻：l 一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。l 数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！l 一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似与一个三极管的C，当C接通过一个电阻和电源连接在一起的时候，该电阻成为上C拉电阻，也就是说，如果该端口正常时为高电平，C通过一个电阻和地连接在一起的时候，该电阻称为下拉电阻，使该端口平时为低电平，作用吗：比如：当一个接有上拉电阻的端口设为输如状态时，他的常态就为高电平，用于检测低电平的输入。l 上拉电阻是用来解决总线驱动能力不足时提供电流的。一般说法是拉电流，下拉电阻是用来吸收电流的，也就是你同学说的灌电流:电阻在选用时，选用经过计算后与标准值最相近的一个！P0为什么要上拉电阻原因有：1. P0口片内无上拉电阻2. P0为I/O口工作状态时，上方FET被关断，从而输出脚浮空，因此P0用于输出线时为开漏输出。3. 由于片内无上拉电阻，上方FET又被关断，P0输出1时无法拉升端口电平。P0是双向口，其它P1，P2，P3是准双向口。不错准双向口是因为在读外部数据时要先“准备”一下，为什么要准备一下呢？单片机在读准双向口的端口时，现应给端口锁存器赋1，目的是使FET关断，不至于因片内FET导通使端口钳制在低电平。上下拉一般选10k！芯片的上拉/下拉电阻的作用最常见的用途是,假如有一个三态的门带下一级门.如果直接把三态的输出接在下一级的输入上,当三态的门为高阻态时,下一级的输入就如同漂空一样.可能引起逻辑的错误,对MOS电路也许是有破坏性的.所以用电阻将下一级的输入拉高或拉低,既不影响逻辑又保正输入不会漂空.改变电平的电位，常用在TTL-CMOS匹配； 在引脚悬空时有确定的状态； 为OC门的输出提供电流； 作为端接电阻； 在试验板上等于多了一个测试点，特别对板上表贴芯片多的更好，免得割线； 嵌位；上、下拉电阻的作用很多，比如抬高信号峰峰值，增强信号传输能力， 防止信号远距离传输时的线上反射，调节信号电平级别等等！当然还有其他的作用了具体的应用方法要看在什么场合，什么目的，至于参数更不能一概而定，要看电路其他参数而定，比如通常用在输入脚上的上拉电阻如果是为了抬高峰峰值，就要参考该引脚的内阻来定电阻值的！另外，没有说输入加下拉，输出加上拉的，有时候没了某个目的也可能同时既有上拉又有下拉电阻的！加接地电阻－－下拉加接电源电阻－－上拉对于漏极开路或者集电极开路输出的器件需要加上拉电阻才可能工作。另外，普通的口，加上拉电阻可以提高抗干扰能力，但是会增加负载。电源：+5V普通的直立LED，共八个，负极分别接到一个大片子的管脚上，用多大的上拉电阻合适？ 谢谢指教！一般LED的电流有几个mA就够了，最大不超过20mA，根据这个你就应该可以算出上拉电阻值来了。保献起见，还是让他拉吧，(5-0.7)/10mA=400ohm,差不多吧,不放心就用2k的 :奇怪，新出了管压0.7V的LED了吗？据我所知好象该是1.5V左右。我看几百欧到1K都没太大问题，一般的片子不会衰到10mA都抗不住吧？上拉电阻的作用：6N137的的输出三极管C极，如果没有上拉电阻，则该引脚上的电平不会发生随B极电平的高低变化。原因是它没有接到任何电源上。如果接上了上拉电阻，则B极电平为高时，C极对地导通(相当于开关接通)，C极的电压就变低；如B极电压为低，则C极对地关断，C极的电压就升到高电平。为就是上面说的“将通断转换成高低电平”。你说的51与此图有一定的不同，参照着去理解吧。另外，一般地，C极低电平时器件从外部吸入电流的能力和高电平时向外部灌出电流的能力是不一样的。器件输出端常有Isink和Isource两个参数，且前者往往大于后者。下拉电阻的作用：所见不多，常见的是接到一个器件的输入端，多作为抗干扰使用。这是由于一般的IC的输入端悬空时易受干扰或器件扫描时有间隙泄漏电压而影响电路的性能。后者，我们在某批设备中曾碰到过。上拉电阻的阻值主要是要顾及端口的低电平吸入电流的能力。例如在5V电压下，加1K上拉电阻，将会给端口低电平状态增加5mA的吸入电流。在端口能承受的条件下，上拉电阻小一点为好。提高负载能力、提高直流工作电平无信号是给电路提供确定的电平。上拉 一端接vcc，一端接在引脚上下拉：一端接gnd，一端接在引脚上<br / 接地是电器安全技术中很重要的工作之一，接地装置的合适与否，接地电阻值是否合乎标准要求，直接影响到电力系统设备的正常运行，影响到建筑物的安全，还关系到人身安全。因此，应当正确选择接地方法及测量接地电阻。现依据接地电阻的测量原理及结合实际测试，提出下述测量接地电阻的几点经验。一、测量前的分析
测量前应掌握埋地电极的分布情况(最好查阅竣工图)，然后依据公式:
(s为电极系统所覆盖的面积)，并按图纸计算接地系统的有限半径，以确定辅助电极的远近位置和朝向。
二、引出测量点
如果测量点不易接出，可以用一根电阻较小的电线引出，把电线的引出端接到表的E端，测量结果应减去电线的电阻，此时电线的自感要引入误差，所以应尽量将电线拉直，多余的线应绕成无定向结构。对于有四线测量功能的接地电阻表，应引出两条电线，分别接表上的E1、E2，四线法测量的阻抗不影响测量结果。
三、关于辅助电极的接地电阻
一般辅助电极的接地电阻小于5kΩ时，不影响测量结果，但如果电流电极接地电阻Rc太大，将使注入电流减小，易受干扰。如果电压电极接地电阻Rp太大，将与电压表的输入电阻分压，使电压测量不准，灵敏度下降。20cm长的铁钎打入干松土壤的接地电阻一般小于1kΩ。为了降低辅助电极的接地电阻，可以在辅助电极周围浇水。经常会遇到水泥地面无法打桩的情况，这时，可用一根铁链盘在水泥面上，再浇上水；作为辅助电极，也可用金属网代替铁链，浇水是为了降低辅助电极的接地电阻。
四、辅助电极的延伸方向
辅助电极的延伸方向要避免与地下管线、地面水沟平行靠近，无法远离这些导体时，最好选垂直或交叉方向。
五、关于辅助电极的位置
3个电极不必在同一直线上，辅助电极的位置遵循“互电阻影响最小”的原则，如果电流电极C与被测电极E的距离满足DEC>11rE，电压电极P的位置可以偏离直线约束，理论上只要(1/DEC-1/DPC+1/DEP)=0，互电阻的影响可以抵消。实际测量时，应在不同位置测量几次P电极。
六、测量时，埋地电极是否要与内部断开
有的接地电阻表要求断开测量，有的不要求，主要出于以下几点考虑，若不断开，将会出现以下情况:
1.如果被测电极接地电阻很大或在地下断线，则测量仪表中的电流源或发电机就会开路，然后开路电压通过内部地线系统传导到内部仪器、设备的机壳上。手摇发电机的开路电压一般为100V以上，电池供电的电流源开路电压一般在50V以下。
2.如果内部用电设备泄漏电流，将从被测电极向大地注入电流，在周围的地面上产生电压降，叫做地电压，地电压小则影响测量结果，大则威胁人员安全或损坏接地电阻表。
3.有些不规范的接地方法，把原本独立的两个接地系统通过仪器、设备的机壳连接起来，接地电阻表测得的电阻值并不是单个接地电阻，而是两个系统接地电阻的并联值，甚至被测接地电极断线也不能发现。
测量时最好断开地线，如不能则应注意避免上述情况发生，做到:
(1)先测量地电压，如果E、C两点地电压大于测量仪表的要求，则应关掉相关用电设备，必要时关闭电源。
(2)检查并确定被测电极接地良好，查看两种独立接地系统的连接情况，排除不规范的接地点。现在一般要求接地系统共用地电极，所以不存在两个独立的接地电极，不用考虑外部连接情况。检查断线可以采用测量环路电阻的方法。
七、其他
在测量准确度要求不高的情况下(如日常检查，判断是否断线等)，可以采用两点法测量接地电阻，作为参考的接地电极，要求已知接地电阻，并且独立。这时使用接地电阻表的两线法功能(P、C短路)或者使用钳型接地电阻表加上跨接电阻，比较方便。
虽然土壤的温度、含水量和时间的变化会影响接地电阻的大小，但是对于单次测量来说，它有确定的值，可以准确测量。可是测量时如果不掌握正确的方法，测量结果将会有很大误差。被测对象千变万化，只要能够深刻理解接地电阻的基本定义，掌握接地电阻的测量方法，熟悉接地电阻表测量原理，并且多做实验就能找到最准确的方法。
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