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NTpcb 福州笑话日志

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[问题求助] cadence生成网表出错，很久无法解决，求大神帮帮我

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发表于 2018-6-28 11:30:46 | 显示全部楼层 |阅读模式

问题

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datasheet

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pstchip

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楼主| 发表于 2018-6-28 11:34:13 | 显示全部楼层

原理图

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根据问题描述，应该是管脚不匹配，但是我没发现问题所在

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发表于 2018-6-28 15:53:25 | 显示全部楼层

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发表于 2018-6-29 09:30:33 | 显示全部楼层

大哥你原理图上面就只有两个管脚，怎么匹配涅？

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发表于 2018-7-2 08:37:53 | 显示全部楼层

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发表于 2018-7-2 08:56:03 | 显示全部楼层

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发表于 2018-7-5 08:17:17 | 显示全部楼层

看看，学习学习

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