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DDR等长走线,修改完成

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发表于 2022-5-6 23:12:25 | 显示全部楼层 |阅读模式

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按照上次点评的作业,修改了DDR走线,主要改了时钟线,顶层引脚勾线,电源和地引脚过孔太远
DDR等长修改.png

DDR等长修改顶层.png

DDR等长修改信号层.png

刘亿_项目1-DDR拉线作业(等长修改完).pcb (1.13 MB, 下载次数: 0)
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    发表于 2022-5-7 10:00:46 | 显示全部楼层
    打这么多过孔   是不是位置错了,,打这么多过孔   是不是位置错了,,打这么多过孔   是不是位置错了,,
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    发表于 2022-5-8 08:31:11 | 显示全部楼层
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    发表于 2022-5-8 08:31:11 | 显示全部楼层
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     楼主| 发表于 2022-5-9 21:25:17 | 显示全部楼层

    回 b838899 的帖子

    没有吧,一个信号两个过孔,走顶层和第三层,其他都是电源和地孔
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