PADSLogic提示： Connection can't tie into bus琀栀椀猀眀愀礀怎

老吴 · 发表于 2014-11-22 12:05:52

元器件的端子栅格必须与原理图的相同
你的设计栅格不匹配你重新画下这个原件的封装图。让元器件的端子栅格和原理图的一样就好了。

另外画线的栅格要跟总线的栅格一至。不然容易出这个问题。

显示全部楼层 · 发表于 2014-11-23 09:10:58

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xwmyes · 发表于 2015-10-28 17:45:03

原理图的栅格和PCB的栅格有毛子关系？

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水很深我该用户已被删除	发表于 2014-11-23 09:10:58 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽︾展开阅读全文︾
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