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项目2作业已完成,有个小问题。
项目二走线还没完成,自己规划走线时方向比较乱
项目二作业以拉通DDR和等长,有问题文件名一定要pdj-2打开
项目一最终作业
项目一作业,布局PCB和原理图交互有些元件不同步
VL812原理图作业
GS12170+TLV320DAC3100+STM32F205RCT6+74LVC1T45+GS12341+SN75DP159allegro做的H
LAN8720
ADV7123KST140
SN74LVTH245APWR
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