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[技术讨论]关于DDR阻抗匹配问题 [复制链接]

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离线swunzg

性别:: 帅哥

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只看楼主倒序阅读使用道具 0楼发表于: 2019-07-28

请教论坛大神两个问题：
1.ddr3布线只做等长，pcb板子不做阻抗匹配，在靠近cpu处串接合适大小的匹配电阻行不行？
2.Vtt上拉电阻什么时候用，都是4颗DDR3，有的板子加了Vtt上拉电阻，有的又没加

用仿真看了一下只要串接的电阻和走线的阻抗接近，振铃、过冲都能明显抑制。

为什么有这个想法，因为看到有家pcb厂195块能做四层板，给了两个固定的层叠结构可选择，计算了一下，线宽4mil时阻抗是60欧左右，线宽6mil时阻抗才是50欧左右，但是6mil又不好走线。

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在线bidinghong

百人实战Pads学员-1期

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学习学习

在线kenxjy

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越来越好

离线单枪舞九州

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支持

离线xiaoxiao

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来看看了

离线wangy2000

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收藏谢谢分享。

离线hbjsss

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离线shakencity

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离线学海无涯

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不错，厉害。学习了。

离线weiziushi

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学习了

在线mj8abcd

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离线lis998

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离线swunzg

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离线地球很危险

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离线羊毛

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1.看你的速度, 333M的话可以这样：地址线上的匹配电阻靠近CPU数据线上的匹配电阻靠近DDR
2.DVTT上拉是增加驱动能力的

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