关于LPDDR3与DDR3挂多芯片走线的研究
主要讨论LPDDR3 Layout的注意事项:1、 信号线及差分线包地且有对应的参考层。
2、 信号线与差分线组间控制等长,一般相差在100mil以内。
3、 信号线之间的线距大于两倍线宽。
以上几点重点注意事项,还有没要补充的。
还有一个研究方向,LPDDR3 64位改成两个32位的走线研发,也很有挑战性,如果有人一起研究,我可以给出对应的一些参考设计出来。 有没做DRAM这行的,可以一起交流下 非常好的资料,谢谢了 学习下, 非常好,谢谢 谢谢分享。 这个放到这个板里面是不是不合适呢? 谢谢分享 一探究竟 来看看
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