问一数据走线问题

2dmin

我最近走线遇到了很大的麻烦，就是在周数据线的时候碰到了两种情况，不知道怎么处理。
一，就是数据线经过匹配电阻，前后走线在不同层次。如，R10，前端连接FPGA，后端连接大DA，前端在表层走线，后端中间层走线，会有多大影响，假设频率在37m，128m，500M会出现多大影响
二，就是假设8条数据线，6条走线一样，2条走在其他不同层次，D0....D7，D0。。D5在表层，D6，D7在中间层，会有多大影响，频率分别在37M，128M，和500M得时候% R, J9 q2 L3 x
谢谢给为，小弟可能表达能力差，