cadence生成网表步骤

lajikao · 发表于 2019-4-29 16:16:38

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1、生成netlist前的准备工作

检查逻辑功能是否正确

重新对整个工程进行索引编号—右键整个工程-Annotate-reset…（第三个）-确定，右键整个工程-Annotate-（第一个或第二个）

对整个工程进行DRC检查—选择整个工程-tools-Design Rules Check,除了SDT外其余全都进行检查
2、生成netlist方法

选中整个工程—Tools-Create Netlist，标签栏选中PCB Editor,点击确定就能生成网表
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lajikao · 发表于 2019-4-29 16:18:31

marktsui · 发表于 2019-4-30 00:08:49

chjd · 发表于 2019-4-30 08:35:02

hgr211 · 发表于 2019-4-30 08:35:37

cxhhqz · 发表于 2019-4-30 08:38:56

导入呢？用第一方还是第三方？

梁先生 · 发表于 2019-4-30 08:56:20

谢谢分享

南亭好远 · 发表于 2019-4-30 08:58:06

了解一下

樊二强子 · 发表于 2019-4-30 08:59:43

nt没我nt · 发表于 2019-4-30 09:26:44

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