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FFT Verilog RTL - FPGA/CPLD - 电子工程师俱乐部

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发表于 2013-3-30 09:33:59 | 显示全部楼层 |阅读模式

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经过测试与Altera FFT IP相当。Radix-2 DIT地址无冲突，流水线设计。很不错。推荐使用reg signed val_name，不必自己进行符号扩展了。

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rtl.rar

<em class="xg1">(6.95 KB, 下载次数: 86)

</em>

2010-7-8 10:24:18 上传
下载次数: 86
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