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楼主: kakaru

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     楼主| 发表于 2021-1-15 12:15:20 | 显示全部楼层
    有人指出了CSP和BAT管脚的走线没有按照手册建议来,我补充一点看法:
    CSP和BAT我的确没有按照手册走线,之所以要求同层伪差分布线应该是减少走线对采样电阻的精度影响,我这个走线导致两者差了约10mR,但它是定值,方向上相当于增大了采样电阻,减小了充电电流。如果知道实际的影响,并且该影响完全可以接受,到也不影响实用。

    类似的问题还有,我没有在续流二极管旁边增加抑制高频的器件,一者实际没什么影响,二者省点钱。
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